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dsp＋fpga 文章 最新資訊

基于FPGA的寬帶數(shù)字接收機(jī)變帶寬數(shù)字下變頻器

  • 變帶寬數(shù)字下變頻器（VB-DDC）可以對(duì)多種帶寬的輸入信號(hào)進(jìn)行處理，因此在雷達(dá)、通信、電子偵察等領(lǐng)域有廣泛應(yīng)...
  • 關(guān)鍵字： FPGA  帶寬可變  VB-DDC  StratixII  

實(shí)時(shí)嵌入式產(chǎn)品的測試系統(tǒng)設(shè)計(jì)

  • 實(shí)時(shí)嵌入式產(chǎn)品的測試系統(tǒng)設(shè)計(jì),摘要：主要介紹針對(duì)高實(shí)時(shí)性的嵌入式產(chǎn)品而開發(fā)的測試系統(tǒng)的設(shè)計(jì)，簡單介紹了被測試系統(tǒng)的特性，從整個(gè)測試系統(tǒng)的設(shè)計(jì)思想、設(shè)計(jì)原理，包括軟件和硬件等方面，給出詳細(xì)的介紹。另外，比較了不同方案設(shè)計(jì)的優(yōu)缺點(diǎn)，為
  • 關(guān)鍵字： 嵌入式  測試系統(tǒng)  RTX  FPGA  通信  

基于FPGA實(shí)現(xiàn)的SCI接口電路IP核的設(shè)計(jì)

  • 隨著超大規(guī)模集成電路(VeryLargeScaleIntegrationVLSI)工藝技術(shù)的發(fā)展，芯片的規(guī)模越來越大，集成規(guī)模...
  • 關(guān)鍵字： FPGA  IP核  SCI接口電路  VLSI  

基于FPGA的65nm芯片的設(shè)計(jì)方案

  • 基于FPGA的65nm芯片的設(shè)計(jì)方案,　　隨著工藝技術(shù)向65nm以及更小尺寸的邁進(jìn)，出現(xiàn)了兩類關(guān)鍵的開發(fā)問題：待機(jī)功耗和開發(fā)成本。這兩個(gè)問題在每一新的工藝節(jié)點(diǎn)上都非常突出，現(xiàn)在已經(jīng)成為設(shè)計(jì)團(tuán)隊(duì)面臨的主要問題。在設(shè)計(jì)方法上從專用集成電路(ASIC)和
  • 關(guān)鍵字： 設(shè)計(jì)  方案  芯片  65nm  FPGA  基于  

FPGA架構(gòu)的功耗及影響功耗的用戶選擇方案

  • FPGA架構(gòu)的功耗及影響功耗的用戶選擇方案,　　本文將介紹FPGA的功耗、流行的低功耗功能件以及影響功耗的用戶選擇方案，并探討近期的低功耗研究，以洞察高功率效率FPGA的未來趨勢(shì)?！　」牡慕M成部分　　FPGA的功耗由兩部分組成：動(dòng)態(tài)功耗和靜態(tài)功耗。信號(hào)給
  • 關(guān)鍵字： 功耗  選擇  方案  用戶  影響  架構(gòu)  FPGA  

基于VHDL和發(fā)接復(fù)用器的SDH系統(tǒng)設(shè)計(jì)及FPGA仿真

  • 基于VHDL和發(fā)接復(fù)用器的SDH系統(tǒng)設(shè)計(jì)及FPGA仿真,　　針對(duì)目前國內(nèi)SDH系統(tǒng)中還沒有一個(gè)專門的E1分接復(fù)用芯征，本文介紹一種用高級(jí)硬件描述語言VHDL及狀態(tài)轉(zhuǎn)移圖完成該發(fā)接復(fù)用器的設(shè)計(jì)的新型設(shè)計(jì)方法及其FPGA實(shí)現(xiàn)。并給出了用Xilinx FoundaTIon tools EDA軟件設(shè)計(jì)的
  • 關(guān)鍵字： 設(shè)計(jì)  FPGA  仿真  系統(tǒng)  SDH  VHDL  復(fù)用器  基于  

用FPGA+DSP實(shí)現(xiàn)HDLC(高級(jí)數(shù)據(jù)鏈路控制)功能

  • 用FPGA+DSP實(shí)現(xiàn)HDLC(高級(jí)數(shù)據(jù)鏈路控制)功能,　　引言　　HDLC的ASIC芯片使用簡易，功能針對(duì)性強(qiáng)，性能可靠，適合應(yīng)用于特定用途的大批量產(chǎn)品中。但由于HDLC標(biāo)準(zhǔn)的文本較多，ASIC芯片出于專用性的目的難以通用于不同版本，缺乏應(yīng)用靈活性。有的芯片公司還有自己
  • 關(guān)鍵字： 鏈路  控制  功能  數(shù)據(jù)  高級(jí)  DSP  實(shí)現(xiàn)  HDLC  FPGA  

語音信號(hào)的A律編解碼的DSP實(shí)現(xiàn)

  • 語音信號(hào)的A律編解碼的DSP實(shí)現(xiàn),摘要：本文介紹了G．711標(biāo)準(zhǔn)的A律壓縮算法的基本原理，設(shè)計(jì)出了A律編解碼的軟件流程框圖，在以TMS320VC5416為處理器的硬件開發(fā)平臺(tái)上實(shí)現(xiàn)了語音信號(hào)的A律壓縮解壓算法，并給出了C54x的匯編語言程序。
    關(guān)鍵詞：數(shù)字信
  • 關(guān)鍵字： DSP  語音  

基于FPGA的圖像調(diào)焦系統(tǒng)研究

  • 摘要：采用基于圖像技術(shù)的自動(dòng)調(diào)焦方法，根據(jù)圖像分析出圖形的質(zhì)量，完成圖像預(yù)處理、清晰度判別，獲得當(dāng)前的成像狀況。通過控制電機(jī)，完成調(diào)焦操作。其中核心技術(shù)是分析圖像質(zhì)量評(píng)價(jià)函數(shù)。針對(duì)調(diào)焦算法計(jì)算量大、計(jì)
  • 關(guān)鍵字： FPGA  圖像調(diào)焦  系統(tǒng)研究    

一種基于CPLD的聲發(fā)射信號(hào)傳輸系統(tǒng)設(shè)計(jì)

  • 聲發(fā)射技術(shù)是光纖傳感技術(shù)和聲發(fā)射技術(shù)相結(jié)合的產(chǎn)物，是目前聲發(fā)射技術(shù)的發(fā)展趨勢(shì)。它將高靈敏度聲發(fā)射傳...
  • 關(guān)鍵字： CPLD  FPGA  信號(hào)傳輸  聲發(fā)射  

基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù)

  • 基于LatticeXP2設(shè)計(jì)的FPGA標(biāo)準(zhǔn)評(píng)估技術(shù),LatticeXP2器件包括基于查找表（LUT）的 FPGA以及非易失閃存單元（flexiFLASH）。LatticeXP2系列器件的LUT從5K到40K，分布是RAM從10K到83Kb，EBR SRAM從166Kb到885Kb，EBR SRAM區(qū)塊從9到48個(gè)，sysDSP從3個(gè)到8個(gè)，18x
  • 關(guān)鍵字： 評(píng)估  技術(shù)  標(biāo)準(zhǔn)  FPGA  LatticeXP2  設(shè)計(jì)  基于  

基于DSP芯片TMS320LF2407A的超聲電源系統(tǒng)的控制電路

  • 基于DSP芯片TMS320LF2407A的超聲電源系統(tǒng)的控制電路,　　本文利用高速TMS320LF2407A型DSP控制芯片設(shè)計(jì)了系統(tǒng)的控制電路，采用全橋逆變器作為超聲振動(dòng)系統(tǒng)的功率轉(zhuǎn)換主電路，解決由于負(fù)載溫度變化等原因產(chǎn)生諧振頻率的漂移，保證系統(tǒng)的高效率。這里研究了粗精復(fù)合的頻率
  • 關(guān)鍵字： 系統(tǒng)  控制  電路  電源  超聲  DSP  芯片  TMS320LF2407A  基于  

基于FPGA的彩色圖像增強(qiáng)系統(tǒng)

  • 提高顯示器的視覺效果，提出增強(qiáng)比度擴(kuò)展和色飽和度兩種算法，來對(duì)彩色圖像進(jìn)行增強(qiáng)處理，為滿足視頻信號(hào)的實(shí)時(shí)性要求，應(yīng)用FPGA構(gòu)造高速圖像處理系統(tǒng)。實(shí)驗(yàn)結(jié)果表明，本方法能提高圖像的層次感，增強(qiáng)色彩飽和度，達(dá)到顯著提升視覺感受的效果。
  • 關(guān)鍵字： FPGA  彩色  圖像增強(qiáng)  系統(tǒng)    

數(shù)字無線實(shí)時(shí)視頻通信和拍攝系統(tǒng)設(shè)計(jì)

  • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
  • 關(guān)鍵字： 實(shí)時(shí)  DSP  視頻通信  拍攝  
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